{"id":21826,"date":"2025-11-27T13:37:14","date_gmt":"2025-11-27T13:37:14","guid":{"rendered":"https:\/\/pureon.com\/?p=21826"},"modified":"2025-12-02T14:10:12","modified_gmt":"2025-12-02T14:10:12","slug":"grenzen-in-der-sic-waferbearbeitung-verschieben-ultra-niedrige-geometrien-bei-grossformatigen-wafern","status":"publish","type":"post","link":"https:\/\/pureon.com\/de\/grenzen-in-der-sic-waferbearbeitung-verschieben-ultra-niedrige-geometrien-bei-grossformatigen-wafern\/","title":{"rendered":"Grenzen in der SiC-Waferbearbeitung verschieben: Ultra-niedrige Geometrien bei grossformatigen Wafern"},"content":{"rendered":"\t\t
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Grenzen in der SiC-Waferbearbeitung verschieben: Ultra-niedrige Geometrien bei grossformatigen Wafern <\/h1>\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Mit dem \u00dcbergang der Siliziumkarbid-(SiC-)Industrie zu gr\u00f6sseren und d\u00fcnneren Wafern gewinnt ein Faktor zunehmend entscheidende Bedeutung: die Geometrie. Jenseits von Kristallwachstum und Defektdichte ist die Formpr\u00e4zision des Wafers zum entscheidenden Leistungskriterium geworden. Bereits wenige Mikrometer Abweichung k\u00f6nnen dar\u00fcber entscheiden, ob eine Linie effizient l\u00e4uft oder Ausschuss und Kosten verursacht. Auf der ICSCRM 2025 in Busan pr\u00e4sentierte Pureons Chief Innovation Officer, Dr. William Gemmill, die neuesten Fortschritte des Unternehmens bei der Realisierung ultra-niedriger Wafergeometrien. Der Vortrag stellte einen integrierten Ansatz vor, der von Rapid Thinning bis zur finalen CMP-Bearbeitung reicht und eine Geometriekontrolle im Submikrometerbereich im Produktionsmassstab erm\u00f6glicht. Durch Innovationen bei Verbrauchsmaterialien, Prozessdesign und CMP-Template-Technologie zeigte Pureon, wie sich Forschungspr\u00e4zision jetzt in der Serienfertigung realisieren l\u00e4sst.<\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t

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Der 8-Zoll-Durchbruch und der 12-Zoll-Horizont<\/h2>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Der stetige \u00dcbergang der Industrie von 6-Zoll-(150 mm)- zu 8-Zoll-(200 mm)-SiC-Wafern ist l\u00e4ngst kein Experiment mehr, sondern Realit\u00e4t in der Serienproduktion. Zahlreiche Ger\u00e4tehersteller qualifizieren derzeit 8-Zoll-Wafer f\u00fcr Volumenlinien und folgen damit denselben wirtschaftlichen Treibern, die einst das Skalierungsmodell bei Silizium pr\u00e4gten: geringere Kosten pro Die, h\u00f6here Durchs\u00e4tze und Konsolidierung der Lieferkette.<\/p>

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Doch w\u00e4hrend die \u00d6konomie gr\u00f6ssere Durchmesser beg\u00fcnstigt, stellt die Physik sich quer. Bereits 8-Zoll-Wafer stossen an die mechanischen und thermischen Grenzen von SiC; die Einf\u00fchrung von 12-Zoll-Substraten verst\u00e4rkt alle geometrischen Herausforderungen um ein Vielfaches. Bow, Warp und TTV r\u00fccken von einem Hintergrundthema zu zentralen Prozesskriterien.<\/p>

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Diese Entwicklung macht ultra-niedrige Wafergeometrien von einem technischen Unterscheidungsmerkmal zu einem zentralen \u00dcberlebensfaktor. Ohne Beherrschung der Geometriekontrolle w\u00fcrde die Skalierung auf 12-Zoll-Wafer lediglich Kosten- und Ertragsprobleme verst\u00e4rken. Die von Pureon vorgestellten L\u00f6sungen zeigen, wie integrierte Prozessstrategien diese L\u00fccke schliessen und Skalierungsambitionen in produzierbare Realit\u00e4t verwandeln.<\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t

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Warum Wafergeometrie entscheidend ist<\/h2>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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In der SiC-Waferproduktion bestimmt die Geometriepr\u00e4zision direkt die downstream Performance. Parameter wie Total Thickness Variation (TTV), Local Thickness Variation (LTV) und Site Flatness (SFQR) bestimmen, wie gleichm\u00e4ssig epitaktische Schichten wachsen und wie exakt die Lithografie ausgerichtet werden kann. Selbst geringste Verformungen k\u00f6nnen sich entlang der gesamten Prozesskette verst\u00e4rken, die Ausbeute senken und die Kosten erh\u00f6hen.<\/p>

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Mit dem \u00dcbergang von 150-mm- zu 200-mm-Substraten und den ersten 300-mm-Pilotlinien verengen sich die Prozessfenster weiter. Wafer m\u00fcssen flacher, d\u00fcnner und stabiler sein als je zuvor. Ultra-niedrige Geometrievariationen sind daher sowohl technisch als auch wirtschaftlich unverzichtbar.<\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t

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Total Process Solutions<\/h2>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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Aufbauend auf mehr als zwei Jahrzehnten Erfahrung im Bereich SiC-Wafering hat Pureon eine umfassende Strategie entwickelt, die jeden Prozessschritt ber\u00fccksichtigt \u2013 vom S\u00e4gen bis zur finalen Politur. Das Konzept st\u00fctzt sich auf drei Grundprinzipien:<\/p>

  • Skalierbarkeit und Cost of Ownership<\/li>
  • Prozessstabilit\u00e4t und hohe Ausbeuten<\/li>
  • Zusammenarbeit und Versorgungssicherheit<\/li><\/ul>

    Diese Struktur positioniert Pureon als strategischen Roadmap-Partner f\u00fcr das SiC-\u00d6kosystem und erm\u00f6glicht Kunden ein sicheres und reproduzierbares Skalieren.<\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t

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    Rapid Thinning \u2013 Die Br\u00fccke zwischen S\u00e4gen und CMP<\/h2>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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    Im Zentrum der Pureon-Strategie steht der Rapid-Thinning-Prozess, entwickelt, um ges\u00e4gte Wafer mit minimalem Geometrieverlust bis zum finalen CMP-Schritt zu f\u00fchren. Mit einer hochpr\u00e4zisen doppelseitigen Polierplattform, in Kombination mit IRINO-ProSiC-Verbund-Lapping-Pads und PURE-DS-RT-Diamant-Suspensionen, erreichte Pureon au\u00dfergew\u00f6hnliche Prozesskontrolle unter realen Produktionsbedingungen.<\/p>

    Testaufbau:<\/strong><\/p>

    • Tool: AC1200<\/li>
    • Pad\/Suspension: IRINO-ProSiC & PURE-DS-RT<\/li>
    • Flussrate: 40 mL\/min<\/li>
    • Workpieces: 12 \u00d7 150-mm-SiC-Wafer (as-sawn)<\/li>
    • L\u00e4ufe: Lauf 1 (5 min), L\u00e4ufe 2\u20136 (je 20 min)<\/li>
    • Keine Pad-Konditionierung zwischen den L\u00e4ufen<\/li><\/ul>

      Das Ergebnis:<\/strong>
      Selbst nach l\u00e4ngerer Betriebsdauer blieben die TTV-Werte unter 1 \u00b5m, mit praktisch keinem Edge-Roll und nur minimalem Wedge (< 1 \u00b5m). Jeder Prozessschritt entfernte etwa 20 \u00b5m pro Wafer, w\u00e4hrend die Geometrie \u00fcber mehrere L\u00e4ufe hinweg stabil blieb \u2013 ohne Zwischenkonditionierung der Pads und mit geringem Pad-Verschlei\u00df. Diese Kombination aus Durchsatz, Pr\u00e4zision und Reproduzierbarkeit stellt einen entscheidenden Fortschritt f\u00fcr die Volumenfertigung dar.<\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t

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      Verbrauchsmaterial-Innovationen<\/h2>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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      Submikrometer-Geometrie erfordert Verbrauchsmaterialien, die f\u00fcr Stabilit\u00e4t und Kontrolle entwickelt sind:<\/p>

      • Diamantsuspensionen (PURE-DS-RT): Hoher Abtrag bei minimalem Micro-Chipping und glatten Oberfl\u00e4chen f\u00fcr CMP-Vorbereitung<\/li>
      • Schleifpads (IRINO-ProSiC): Langzeitstabilit\u00e4t und konstante Abtragsraten ohne h\u00e4ufiges Dressing<\/li><\/ul>

        So entf\u00e4llt der klassische Zielkonflikt zwischen Abtrag und Pr\u00e4zision.<\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t

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        Fortschrittliches Template-Design: Geometriekorrektur im finalen Prozessschritt<\/h2>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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        Chemical-Mechanical Polishing (CMP) ist entscheidend, um Oberfl\u00e4chen in Device-Qualit\u00e4t zu erhalten, kann jedoch Formverzerrungen verursachen, wenn Druck und Nachgiebigkeit nicht pr\u00e4zise kontrolliert werden. Pureons Forschung im Bereich Verbund-Template-Design setzt genau hier an. Die neuesten Templates kombinieren:<\/p>

        • Starre Substrate und Backing-Schichten f\u00fcr mechanische Stabilit\u00e4t<\/li>
        • Kompressible Filme zur Ausbalancierung der Auflast<\/li>
        • Optimierte Deckschichten f\u00fcr gleichm\u00e4ssigen Kontakt \u00fcber die gesamte Waferfl\u00e4che<\/li><\/ul>

          In der Anwendung auf einseitiges CMP (~ 0,5 bis 0,75 \u00b5m Abtrag auf der Si-Face) zeigten diese Templates deutlich verbesserte Geometriewerte nach dem Prozess und kompensierten kleinere Abweichungen, die sich zuvor angesammelt hatten.<\/p>

          Bei 8- und 12-Zoll-Wafern wird diese adaptive Nachgiebigkeit besonders wichtig. <\/strong><\/p>

          Gr\u00f6ssere Durchmesser verst\u00e4rken jede Asymmetrie in Werkzeugdruck und Carrier-Design. Durch die Feinabstimmung von Steifigkeitsgradienten und den Einsatz kalibrierter thermischer Expansionsschichten gew\u00e4hrleisten Pureons fortschrittliche Templates eine stabile Geometriekorrektur \u00fcber verschiedene Wafergr\u00f6\u00dfen hinweg.<\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t

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          Von Daten zu Wirkung<\/h2>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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          Die Ergebnisse belegen den Effekt des integrierten Ansatzes:<\/p>

          • Konstante TTV-Performance \u00fcber lange Laufzeiten<\/li>
          • Keine Geometriedrift ohne Pad-Dressing<\/li>
          • Vorhersehbare Abtragsraten und Oberfl\u00e4chenqualit\u00e4t bei hohem Durchsatz<\/li>
          • Submikrometer-Korrekturf\u00e4higkeit in CMP<\/li><\/ul>

            F\u00fcr Hersteller bedeutet das: h\u00f6here Ausbeuten, weniger Rework und geringere Betriebskosten.<\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t

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            Kollaborative Innovation und globale Versorgungssicherheit<\/h2>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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            Die Einf\u00fchrung von 8-Zoll-Serienfertigung und fr\u00fchen 12-Zoll-R&D erfordert mehr als Ausr\u00fcstung: Sie verlangt Ecosystem-Kooperation.<\/span><\/p>

            \u00a0<\/p>

            Durch Zusammenarbeit mit Tool-Herstellern, Waferlieferanten und Device-Produzenten unterst\u00fctzt Pureon Kunden bei allen Skalierungsschritten.<\/span><\/p>

            \u00a0<\/p>

            Mit Produktionsstandorten in Asien, den USA und Europa gew\u00e4hrleistet Pureon regionale Versorgungssicherheit und beschleunigt die Validierung neuer Prozessfl\u00fcsse direkt auf 12-Zoll-Pilotanlagen.<\/span><\/p>

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            Geometrie als neue Grenze<\/h2>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t
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            Der n\u00e4chste Fortschritt in der SiC-Waferproduktion wird nicht durch Geschwindigkeit bestimmt, sondern durch Kontrolle \u2013 Kontrolle \u00fcber Geometrie, Gleichm\u00e4ssigkeit und Reproduzierbarkeit. Der Schritt zu 8-Zoll-Mainstream und zum 12-Zoll-Horizon verdeutlicht dies: Skalierung gelingt nur, wenn Pr\u00e4zision mitw\u00e4chst.<\/p>

            Pureons Beitrag auf der ICSCRM 2025 zeigte klar: Ultra-niedrige Wafergeometrien bilden die Grundlage f\u00fcr skalierbare, ertragsstarke und kosteneffiziente SiC-Produktion.<\/p>

            Durch Innovationen in Rapid Thinning, Suspension-Chemie und fortschrittliche Template-Technologie f\u00fchrt Pureon die Industrie in eine neue \u00c4ra pr\u00e4ziser Fertigung.<\/p>\t\t\t\t\t\t\t\t<\/div>\n\t\t\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/div>\n\t\t\t\t\t<\/div>\n\t\t<\/section>\n\t\t\t\t<\/div>\n\t\t","protected":false},"excerpt":{"rendered":"

            Grenzen in der SiC-Waferbearbeitung verschieben: Ultra-niedrige Geometrien bei grossformatigen Wafern Mit dem \u00dcbergang der Siliziumkarbid-(SiC-)Industrie zu gr\u00f6sseren und d\u00fcnneren Wafern […]<\/p>\n","protected":false},"author":3,"featured_media":21830,"comment_status":"open","ping_status":"closed","sticky":false,"template":"","format":"standard","meta":{"footnotes":""},"categories":[54,47],"tags":[],"class_list":["post-21826","post","type-post","status-publish","format-standard","has-post-thumbnail","hentry","category-einblicke","category-unkategorisiert"],"yoast_head":"\nUltra-niedrige Geometrien f\u00fcr grossformatige Wafer<\/title>\n<meta name=\"description\" content=\"Pureons integrierter Ansatz von Rapid Thinning bis CMP erm\u00f6glicht pr\u00e4zise Geometriekontrolle im Submikrometerbereich.\" \/>\n<meta name=\"robots\" content=\"index, follow, max-snippet:-1, max-image-preview:large, max-video-preview:-1\" \/>\n<link rel=\"canonical\" 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